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전자회로 설계 및 실습 예비보고서 3: Voltage Regulator 설계2025.05.141. 전파정류회로 전파정류회로를 사용하여 교류전원으로부터 직류전압을 얻는 기본적인 직류전압 공급기(DC Power Supply)를 설계, 구현, 측정, 평가한다. 2. 직류전압 공급기 설계 5 kΩ의 부하(R_L)에 걸리는 직류전압의 최대치(V_P)가 4.4 V이며, ripple(V_r)이 0.9 V 이하가 되도록 교류입력전원의 크기를 결정하고 커패시터(C)의 크기를 설계한다. 다이오드의 저항은 0.7 kΩ으로 가정한다. 3. PSPICE 시뮬레이션 PSPICE로 회로를 그리고 분석하여 부하에 걸리는 파형을 제출한다. 최대 전압 V...2025.05.14
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전자회로실험 과탑 A+ 예비 보고서 (실험 23 연산 증폭기 응용 회로 1)2025.01.291. 비반전 증폭기 비반전 증폭기는 연산 증폭기의 비반전 단자에 입력 신호를 연결하여 신호를 증폭하는 회로입니다. 이 회로에서 입력 신호가 비반전(+) 단자로 들어가기 때문에, 출력 신호는 입력 신호와 동일한 위상을 가지며, 반전되지 않습니다. 이득은 피드백 저항과 입력 저항의 비율로 결정되며, 높은 입력 임피던스와 낮은 출력 임피던스를 가지는 특성이 있어 신호 처리에 유리합니다. 2. 반전 증폭기 반전 증폭기는 연산 증폭기의 반전(-) 단자에 입력 신호를 연결하여 신호를 증폭하는 회로입니다. 이 회로에서 출력 신호는 입력 신호와 ...2025.01.29
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디지털 회로 실험 및 설계 - JK Flip Flop, D, T Flip Flop 실험 12025.05.161. D 플립플롭 D 플립플롭은 1개의 입력(D)과 2개의 출력(Q, Q') 및 CK를 가지고 있다. 입력 D와 출력 Q는 항상 같으며, 이는 데이터를 기록하는 것과 같아서 D 플립플롭이라는 이름이 붙었다. D 플립플롭 IC 패키지의 특징은 입력이 두 번째, 출력이 다섯 번째와 여섯 번째에 있다. 2. JK 플립플롭 JK 플립플롭은 입력 J와 K가 모두 1일 때, 출력 Q와 Q'의 논리 레벨이 바뀌는 토글(Toggle)이 일어난다. JK 플립플롭 IC 패키지의 특징은 전원이 5번 핀, 그라운드가 13번 핀이다. 3. T 플립플롭 T...2025.05.16
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중앙대 전자회로설계실습 결과1. Op Amp를 이용한 다양한 Amplifier 설계 A+2025.01.271. Op Amp를 이용한 Amplifier 설계 본 실험에서는 Op Amp를 이용하여 다양한 Amplifier 회로를 설계하고 분석하였다. 먼저 센서 구현을 위해 Function generator를 이용하여 정현파를 생성하고 오실로스코프로 측정하였다. 다음으로 Inverting Amplifier 회로를 설계하여 이득을 측정하고 PSPICE 시뮬레이션 결과와 비교하였다. 또한 입력 범위와 주파수 응답 특성을 분석하였으며, 입력 임피던스 변화에 따른 출력 전압 변화를 관찰하였다. 실험 결과를 토대로 설계 목표와의 오차 원인을 분석하고...2025.01.27
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중앙대 전자회로 설계 실습 예비보고서 6_Common Emitter Amplifier 설계2025.01.111. Emitter 저항을 삽입한 Common Emitter Amplifier 설계 설계실습 6. Common Emitter Amplifier 설계에서 Emitter 저항을 사용한 Common Emitter Amplifier 회로를 설계하고자 합니다. Early effect를 무시하고 이론부의 overall voltage gain 식을 이용하여 부하저항에 최대전력이 전달되도록 부하저항을 결정하고, 이를 바탕으로 필요한 저항 값들을 계산합니다. 또한 PSPICE 시뮬레이션을 통해 출력파형을 분석하고 증폭기의 특성을 확인합니다. 2. ...2025.01.11
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[기초전자실험 with pspice] 19 RLC 공진회로 결과보고서 <작성자 학점 A+>2025.04.281. RLC 직렬회로 공진 RLC 직렬회로의 공진주파수는 5.3KHz였으며, 전압은 공진 시 최소값을 가졌다. 이는 리액턴스 성분이 상쇄되고 저항만 남기 때문이다. 공진주파수보다 낮은 주파수에서는 위상이 앞서고, 높은 주파수에서는 위상이 늦춰진다. 2. RLC 병렬회로 공진 RLC 병렬회로가 공진할 때 전류 I1과 I2의 값이 비슷하다. 이는 리액턴스 성분이 상쇄되고 저항만 남기 때문이다. 공진주파수보다 낮은 주파수에서는 I1이 크고, 높은 주파수에서는 I2가 크다. 3. 공진주파수 이론값과 실험값 차이 공진주파수 이론값과 실험값의...2025.04.28
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실험 18_증폭기의 주파수 응답 특성 예비보고서2025.04.281. 공통 소오스 증폭기의 주파수 응답 특성 이 실험에서는 공통 소오스 증폭기의 주파수 응답 특성을 실험하여 대역폭의 개념을 이해하고, 이득과 대역폭 사이의 관계를 파악한다. 증폭기에 사용되는 트랜지스터 내부의 기생 커패시턴스로 인해 주파수에 따라 전압 이득 및 위상이 변하며, 대역폭은 증폭기의 응용 범위를 결정하는 중요한 척도이다. 실험을 통해 증폭기의 전압 이득과 대역폭의 곱이 일정한 관계가 있음을 이해하고자 한다. 2. MOSFET의 고주파 모델 MOSFET의 고주파 대역에서의 소신호 등가회로는 게이트-소스 커패시턴스와 게이트...2025.04.28
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Voltage Regulator 설계 예비보고서2025.04.271. 직류전압공급기(DC Power Supply) 설계 이 보고서의 목적은 교류전원으로부터 직류전압을 얻는 기본적인 직류전압공급기(DC Power Supply)를 설계, 구현, 측정, 평가하는 것입니다. 이를 위해 정류회로와 필터 회로를 사용하여 직류 전압을 생성하고, 오프셋 전압과 슬루율 등의 특성을 분석합니다. 설계 과정에서 수식을 이용하여 부하 전압의 최대치와 리플 전압을 계산하고, PSPICE 시뮬레이션을 통해 결과를 검증합니다. 2. 정류 회로 설계 이 보고서에서는 1:1 변압기와 다이오드를 이용한 정류 회로를 설계합니다....2025.04.27
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A+ 2022 중앙대학교 전자회로설계실습 예비보고서 3 Voltage Regulator 설계2025.05.011. 전자회로설계실습 이 보고서는 중앙대학교 전자회로설계실습 수업의 예비보고서입니다. 학생은 Voltage Regulator 회로를 설계하고 PSPICE 시뮬레이션을 수행했습니다. 설계 과정에서 부하 저항, 변압기 권선비, 커패시터 값 등을 계산하고 시뮬레이션 결과를 분석했습니다. 2. 전압 조절기 설계 이 보고서에서는 5 kΩ 부하에 4.4 V의 직류 전압과 0.9 V 이하의 리플 전압을 공급하도록 전압 조절기 회로를 설계했습니다. 변압기 권선비, 커패시터 값, 주파수 등을 계산하고 PSPICE 시뮬레이션을 통해 결과를 확인했습니...2025.05.01
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[A+] 중앙대학교 전자회로 설계실습 예비보고서 3. Voltage Regulator 설계2025.04.291. 전파정류회로 전파정류회로는 브리지 방식 정류회로로, 다이오드로 인한 전압강하가 2번 발생합니다. 따라서 부하저항 Rl의 2배를 사용하여 식을 변형하였습니다. 전파정류회로의 방전 주기는 반주기(T/2)이므로, 교재의 반파정류회로 수식을 변형하여 사용하였습니다. 2. 직류전압 공급기 설계 문제에서 제시된 조건을 만족시키기 위해 입력전원의 크기와 주파수, 커패시터의 크기를 계산하였습니다. 입력전원은 진폭 5.632V, 주파수 4.889kHz 이상의 정현파를 사용하고, 커패시터는 0.1uF을 사용하면 문제의 조건을 모두 만족시킬 수 ...2025.04.29
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