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컴퓨터구조 - 메모리 맵, 논리회로, 부울대수2025.04.281. 메모리 맵 컴퓨터 구조에서 메모리 맵은 메모리 주소 공간을 나타내는 개념입니다. 이를 통해 RAM 또는 ROM과 같은 메모리 장치의 주소를 표현할 수 있습니다. 메모리 맵은 주소 버스를 통해 표현되며, 이를 이용하여 메모리 장치에 접근할 수 있습니다. 2. 논리회로 논리회로는 논리 게이트를 사용하여 입력 신호를 처리하고 출력을 생성하는 전자 회로입니다. 이를 통해 2입력 논리식, 논리 게이트, 부울 대수 등을 표현할 수 있습니다. 논리회로는 컴퓨터 구조의 기본 구성 요소 중 하나입니다. 3. 부울 대수 부울 대수는 참/거짓 값...2025.04.28
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전자계산시의 논리회로에서 조합논리회로와 순서논리회로의 차이점 및 특징2025.04.271. 조합 논리회로 조합 논리회로는 입력 신호만을 이용하여 출력을 결정하는 회로로, AND, NOT, OR, XOR 등을 기본으로 하여 논리 연산을 수행합니다. 조합 논리 회로는 입력 신호를 통해 출력을 결정하므로 기억 기능이 없으며, 반가산기, 반감산기, 전가산기, 전감산기 등의 종류와 특징을 지니고 있습니다. 2. 순서 논리회로 순서 논리는 조합 논리회로와는 달리 외부로부터 받는 입력과 현재의 상태에 따라 출력이 결정되는 회로로, 기억 장치가 필요합니다. 즉, 순서 논리회로는 입력 신호뿐만 아니라 현재의 내부 상태 값에도 의존하...2025.04.27
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한양대 논리설계및실험 Breadboard 및 기본 논리게이트2025.05.041. 논리 회로 구성 이 실험에서는 칩 회로도를 구성하고 있는 논리 회로를 배우며, AND, OR, NAND 게이트의 input, output 데이터를 숙지하고, 드 모르간의 제 1,2법칙을 통해 input 데이터가 반대일 경우 output 데이터를 추측할 수 있습니다. Breadboard를 이용해 회로를 구성하고 input 값을 다르게 주어 Truth Table 출력값을 확인하는 것이 실험의 목적입니다. 2. 74LS00 NAND GATE 74LS00 NAND GATE는 1,2번으로 들어가서 3번으로 출력되는데, 이 때 반대값이 ...2025.05.04
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[부산대 어드벤처디자인] 10장 flip-flop 및 shift registor 예비보고서2025.01.121. 플립플롭 플립플롭은 출력이 0과 1인 안정된 상태를 가지며 두 개의 출력은 반드시 보수여야 한다. R-S 플립플롭, D 플립플롭, JK 플립플롭, T 플립플롭 등 다양한 종류의 플립플롭이 있으며, 각각의 블록 다이어그램과 여기표(excitation table)를 제시하였다. 2. 레이싱 현상 레이싱 현상은 클럭 펄스가 1일 때 출력상태가 변화되면 입력 측에 변화를 일으켜 오동작이 발생되는 현상이다. 하나의 게이트에 대한 두 개의 입력이 동시에 변할 때 일어나는 문제로, 클럭 펄스의 폭이 출력 상태가 되돌아오는 시각 폭보다 크면...2025.01.12
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[A+보장]한양대에리카A+맞은 레포트,논리회로설게및실험,Latches & Flip-Flops2025.01.151. Latches 래치는 가장 기본적인 기억장치 요소이며, 일반적으로 플립플롭은 래치로 만들어진다. 래치는 순차회로를 직접 구현하기 위한 복잡한 클로킹 방식에 사용되기도 한다. SR 래치와 D 래치에 대해 설명하고 있다. 2. Flip Flops 플립플롭은 래치와 동일한 논리 동작을 하지만, 출력의 변화 시점이 클록의 천이 순간에 동기된다. SR 플립플롭, D 플립플롭, JK 플립플롭, T 플립플롭 등 다양한 종류의 플립플롭에 대해 설명하고 있다. 3. SR Flip Flops SR 플립플롭은 입력 S와 R을 가지며, 클록 신호의...2025.01.15
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0905 논리게이트 레포트2025.01.161. 기본 논리 게이트 조사 디지털 논리 회로의 일종으로, 두 개 이상의 입력과 하나의 출력으로 구성된다. AND 게이트는 두 입력이 모두 참일 때만 출력이 참이 되고, OR 게이트는 입력 중 하나 또는 모두가 참일 때 출력이 참이 된다. NOT 게이트는 단일 입력을 가지며, 입력이 참이면 거짓을, 입력이 거짓이면 참을 출력한다. 1. 기본 논리 게이트 조사 기본 논리 게이트는 디지털 회로 설계의 기본 구성 요소로, AND, OR, NOT 등의 기본 논리 연산을 수행합니다. 이러한 논리 게이트는 복잡한 디지털 시스템을 구축하는 데 ...2025.01.16
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광운대학교 전기공학실험 실험7. 디코더와 인코더 결과레포트2024.12.311. 디코더와 인코더 이 실험은 코드의 개념을 이해하고 이진코드와 BCD코드가 무엇인지 숙지하는 것을 목표로 합니다. 또한 디코더와 인코더의 원리와 구성방법을 실험을 통해 이해하고 이를 응용 및 설계하여 실용적 목적 회로 구성에 대한 연습을 진행합니다. 실험을 통해 NAND 게이트로 구성한 논리회로가 기존 회로와 동일하게 작동하는 것을 확인하였고, 74138 디코더와 74148 인코더의 동작 원리를 이해할 수 있었습니다. 또한 Enable 기능과 회로 구성법, 진리표 분석, 우선 기능 등을 실험적으로 확인할 수 있었습니다. 1. 디...2024.12.31
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논리회로와 부울대수, 카르노맵의 기본개념 및 상관관계2025.05.121. 논리회로 논리회로는 논리 게이트를 조합하여 논리식으로 표현한 것으로, 디지털 회로를 구성하는 기본적인 요소이다. 논리회로는 하나 이상의 이진 입력 값에 대해 논리 연산을 수행하여 논리적 출력 값을 얻도록 불 대수를 구현한 물리적 장치이다. 2. 부울대수 부울대수는 논리회로를 간단하게 하기 위한 수학적 도구이다. 부울대수에서는 참을 1, 거짓을 0으로 나타내고, NOT, AND, OR, XOR 등의 논리 연산자를 다룬다. 부울대수는 컴퓨터과학 분야에서 논리 연산을 수행하는데 중요한 역할을 한다. 3. 카르노맵 카르노맵은 임의의 ...2025.05.12
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[논리회로실험] 실험7. Shift Register 결과보고서2025.05.081. Shift Register 이번 실험에서는 Shift Right Register와 순환 레지스터를 직접 구현해보고 결과를 통해 truth table을 작성하고 시프트 레지스터의 특성을 알아보았습니다. 실험 1의 경우 6 bit shift right register를 구현했고, 실험 2의 경우 단일 IC칩을 사용하여 5bit 시프트 레지스터를 구현했습니다. 실험 3에서는 circulating shift register를 구현하였고, 실험 2와 결과 값은 별 차이가 없지만 QA, QB가 on이 되는 시점부터 다시 shifting ...2025.05.08
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전기및디지털회로실험 실험 3. 부울대수와 논리조합 예비보고서2025.05.101. 부울대수 부울대수(Boolean algebra)는 1 또는 0의 값에 대해 논리 동작을 다루는 대수입니다. 부울대수 연산자에는 논리합, 논리곱, 부정 연산자가 있습니다. 부울대수는 일반 대수와 규칙이 다르며, 관련 법칙과 정리가 있습니다. 동일 법칙, 지배 법칙, 등멱 법칙, 부정 법칙, 교환 법칙, 결합 법칙, 분배 법칙, 드 모르간 법칙, 이중 부정 법칙 등이 있습니다. 2. 드 모르간 법칙 드모르강의 정리는 변수의 합이나 곱의 형태를 서로 바꾸어가며 식을 단순화하는데 유용하게 사용됩니다. 드모르강의 제1법칙은 AxB의 보...2025.05.10
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